MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
  D! B7 R. _: K3 ^input mcasp_ahclkx,5 g+ b4 |9 |- j6 Y
input mcasp_aclkx,
* Q4 I* c  q4 Y$ uinput axr0,
1 `+ X( K1 ~$ G' `- |6 M- v5 V2 i5 \" E5 z8 L) k
output mcasp_afsr,6 S9 |, u3 r% A9 C* u3 U8 v
output mcasp_ahclkr,
  _* U  c3 p" u4 \output mcasp_aclkr,
# b0 f! e7 W+ l7 C: H% ~output axr1,& [4 ?# x. I: `3 {, r5 b' l% b
assign mcasp_afsr = mcasp_afsx;- |( E! [8 E. O2 |
assign mcasp_aclkr = mcasp_aclkx;
4 G/ x2 v$ P. H- x; p7 |  hassign mcasp_ahclkr = mcasp_ahclkx;7 F0 P+ y& D  R. u& w' i% F8 m
assign axr1 = axr0;

6 u  |1 ]+ x1 `4 q# L* p+ o" ^+ g$ R  `& T' Q1 }2 a" r
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

+ E1 [" P. v5 w4 l9 R
static void McASPI2SConfigure(void)
- {# p! Q& @+ D# w" r2 t6 O{
, |3 A9 g' j; Y( ~McASPRxReset(SOC_MCASP_0_CTRL_REGS);
% ~' a- K- F1 S! F3 u& O* bMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
. U' p" U5 i$ R; V% dMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
+ ~, K3 r) i1 A1 H7 k' A8 IMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
2 V4 M$ D! Z' t) o5 X0 pMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# ~- x$ f+ ~/ }
MCASP_RX_MODE_DMA);
. X% l  p3 u0 t. S  c4 R3 IMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
7 }2 o1 T  {# R, U$ A5 n8 f0 pMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */; ~- m+ T0 p5 M9 t9 l
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
' e* O! h/ L3 I9 B# b$ Q0 B+ `) U- EMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
# y% J9 w2 s2 A! W4 @. {McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
5 n; `6 E1 F7 K% u  a. eMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
$ D+ Q6 g3 E- _( L# U- q6 p/ uMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);8 e' y& z: {  ~4 V/ ?
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ) n2 S+ p: j8 Y: L
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,; H" q* H' g  r4 ^% j
0x00, 0xFF);
/* configure the clock for transmitter */0 {% K9 u& V( z6 n# z
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);$ z, M9 |) H* O2 l* A9 }5 F
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
# \6 Z% B5 A3 m5 O1 IMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
* [* W! w' y3 h! C0x00, 0xFF);
  o' ~$ g- V! I$ l/ A" C
5 C1 {7 E" D1 R6 Z9 ]0 q/* Enable synchronization of RX and TX sections */
' c& g: `. P+ s. ~8 J0 [; y7 wMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */0 [3 c* T  X0 c
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
4 ]2 U: r$ t' W# z% {8 XMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
7 o7 @$ u- x) w** Set the serializers, Currently only one serializer is set as. b* D+ J4 [/ b1 z0 s
** transmitter and one serializer as receiver.' J9 P/ |9 O3 \4 O
*/
" i9 m9 n+ p+ E# m' L- iMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);9 y# H4 ^7 p" S/ x/ h9 P
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
& ^6 n8 P! u4 t2 ^6 O3 s) J** Configure the McASP pins ' n# A# i, ]- h( ^1 s& w! t+ L- B  }4 H
** Input - Frame Sync, Clock and Serializer Rx
! I8 t5 D1 s$ N, M1 _: d** Output - Serializer Tx is connected to the input of the codec
8 n4 H: L. E3 S1 \) i*/: n- q+ l4 I! z- H* q
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
& S" D/ `' f5 K3 Z  yMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));: }4 w' N0 {9 B: h9 W# E$ y- S6 B" S
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
, G- b0 Z2 {9 H0 D# B! N( q- ~| MCASP_PIN_ACLKX
- W1 |# L7 S2 o% ~6 f| MCASP_PIN_AHCLKX
) g0 q" t3 z9 i+ M| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */3 F% L6 s$ h7 \! s
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 3 h  }) L1 X# K6 n' S) k, X) m
| MCASP_TX_CLKFAIL ' r. ^& a6 f8 }: i# Z
| MCASP_TX_SYNCERROR6 f3 m: b! l3 i" l* p
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 3 l! c  w' g: ?4 A6 w  p. }
| MCASP_RX_CLKFAIL) ]. Y/ p* J) C+ K! q$ N
| MCASP_RX_SYNCERROR
3 z/ _/ X0 P; J. N| MCASP_RX_OVERRUN);/ e, k: u. i& [$ t
}
static void I2SDataTxRxActivate(void)2 H% d0 n1 n) t/ O) @! ]; Z, q
{2 I8 P: `' ?/ ?2 J6 g
/* Start the clocks */
9 k8 i" _4 M% K* M  o3 h' e% |McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
  i, z4 {/ S! LMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */1 @+ O8 O0 \- u4 \+ l8 v! m; O
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,1 h- |9 B  @# {/ D0 M0 b
EDMA3_TRIG_MODE_EVENT);- H3 v, L5 v/ c1 T
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
. m% a7 E4 Z6 T0 o2 p/ X* ]7 qEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */8 r- f4 X  ^0 n
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
& h, [& p4 B: hMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
( V- o* G; z& C/ B$ @7 q& ]while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
9 [9 D/ m1 ^" e4 v" y6 nMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);2 J, p: f, M( N% k! @/ v
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);! r* f- v8 C- H1 H  I! h; H: ^
}

% H6 S% L( o1 \& l2 K% f$ p
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

: V: N: r9 p  k  Q
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