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upp问题

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发表于 2014-12-22 14:36:25 | 显示全部楼层
本帖最后由 希望缄默 于 2014-12-22 14:38 编辑

在操作系统中 任务一般都是一个无限循环

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沙发
发表于 2014-12-22 18:43:24 来自手机 | 显示全部楼层
把缓存禁用
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发表于 2014-12-23 09:30:50 | 显示全部楼层
tulipyyf 发表于 2014-12-23 08:32
关闭缓存和打开缓存我都测试了一下,好像没有改变。

你是怎么操作的?
直接在内存管理中将缓存全部配置为内存
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发表于 2014-12-23 09:52:25 | 显示全部楼层
tulipyyf 发表于 2014-12-23 09:49
关闭了,好像没有问题了~~谢谢,刚才操作错误。



使用缓存需要编程的时候考虑缓存一致性的问题~
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发表于 2014-12-23 09:53:05 | 显示全部楼层
tulipyyf 发表于 2014-12-23 09:51
难道使用UPP 的DMA 就必须关闭DDR 的 cache缓存吗?

跟 uPP 没有关系
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发表于 2014-12-23 09:58:45 | 显示全部楼层
tulipyyf 发表于 2014-12-23 09:57
我数组设置的是全局变量
Uint16 upp_buffer_a;
Uint16 upp_buffer_b;

使用缓存需要编程的时候考虑内存地址对齐及缓存一致性的问题~
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发表于 2015-1-16 16:36:52 | 显示全部楼层
378087736 发表于 2015-1-16 14:01
那如果不关闭cache,操作UPP的时候,数组起始地址需要64字节对齐吗?

需要
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发表于 2015-1-21 20:27:39 | 显示全部楼层
378087736 发表于 2015-1-21 15:06
syslink下关闭DSP的cache是在config.bld中把l1DMode:"32k", l1PMode:"32k",l2Mode:"32k"这几项去掉么? ...

看 DSP 视频教程 第5章
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发表于 2015-4-29 13:38:39 | 显示全部楼层
cqf00 发表于 2015-4-28 08:59
如果跟upp没有关系,那如何对一段使能了L1、L2缓存的DDR2内存数据,实现upp的正确收发。(使用的是C6748评 ...

用了缓存大部分情况就要维护缓存一致性
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发表于 2015-4-29 17:23:51 | 显示全部楼层
cqf00 发表于 2015-4-29 16:13
在这之前,我找了不少的资料了,很大程度上,也认为是缓存一致性的问题。
我也查阅了TI的关于cache方面的 ...

参考 EMIF_AD7606v2 例程

如果你还是不清楚的话 就等待我们发布更新的例程吧
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