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和FPGA通信问题

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楼主
发表于 2016-11-2 11:17:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
当我cmd文件中.text等全部放在SHDSPL2RAM上时,通信正常,当我放到DDR上时,通信数据会出错,求大神?这是哪个造成的?
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创龙

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沙发
发表于 2016-11-2 11:31:18 | 只看该作者
有没有开缓存?
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 楼主| 发表于 2016-11-2 13:19:47 | 只看该作者
希望缄默 发表于 2016-11-2 11:31
1 C# D1 d* ?8 G  j" ^# U- \9 O有没有开缓存?
3 O+ ]% G# b/ R7 `) w
什么开缓存?貌似没有吧,怎么开,有资料么?
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创龙

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地板
发表于 2016-11-2 22:20:43 | 只看该作者
TI参考文档-TI C64x DSP CACHE 一致性分析与维护
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