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标题: 和FPGA通信问题 [打印本页]

作者: supeng 时间: 2016-11-2 11:17
标题: 和FPGA通信问题
当我cmd文件中.text等全部放在SHDSPL2RAM上时，通信正常，当我放到DDR上时，通信数据会出错，求大神？这是哪个造成的？

作者: 希望缄默 时间: 2016-11-2 11:31
有没有开缓存？

作者: supeng 时间: 2016-11-2 13:19

希望缄默发表于 2016-11-2 11:313 `) p. l/ |. w7 M. D
有没有开缓存？

什么开缓存？貌似没有吧，怎么开，有资料么？

作者: human 时间: 2016-11-2 22:20
TI参考文档-TI C64x DSP CACHE 一致性分析与维护

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