对l138与fpga通信例程tl-devmem2的复现与使用 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[已解决] 对l138与fpga通信例程tl-devmem2的复现与使用

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发表于 2018-9-5 20:16:08 | 显示全部楼层 |阅读模式
硬件平台:omapl38F核心板;
  R: \" X4 D6 s1 t) K4 n( c# l7 f复现方式:按照pdf:omapl38基于emifa总线与FPGA的通信测试进行例程复现,并将写数据部分提取出来进行使用;5 |4 R& E! g) T# w" o2 f, u+ F; }
问题:在对fpga这边数据进行抓包观察时发现:
0 ~8 k$ m8 c7 X& W& F$ m1、16根数据线仅有低八位在使用,高八位置一,当传输16bit数据时,会将两个字节按先小端后大端的顺序从低八位数据线按序输出;
! c$ c) s2 e% V2、同时地址线只有addr1,addr2,addr3三根是有效的,其他线长期置一,并且地址线并不随数据变化而变化,而是每隔8到11个写使能而进一位;0 z( Y9 q* @2 z: i: {
3、emifa_clk时钟线并不能作为时钟提供给fpga,在对fpga另加其他时钟并对emifa_clk进行抓包时现象为长期置高;( @9 e& v% @/ U, ]3 b+ E" Y; V
4、片选emifa_cs2和写使能emifa_we的拉低时间比并不符合dsp与fpga通信时的2,3,2关系,请问arm与fpga通信时这个时序是什么,同时其依靠的时钟是多大,还是114MHz吗?1 r6 ?- @& t5 i' K: e

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发表于 2018-9-7 15:39:11 | 显示全部楼层
你好,针对您的问题有一下疑问:
0 k8 u9 ?7 D+ Y6 b. ~/ n+ d5 c! a1 y* G. e) m  ~
1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?
( N' e. D; i3 Q! k; C2.是否有确认过FPGA端的程序与DSP端的程序数据传输的位数是否匹配?
: Y! I* N3 S" q+ h- H8 k
" \- r  _+ d/ y" u3 s
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 楼主| 发表于 2018-9-7 16:26:05 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 15:39
; r! M9 g2 x# a; Q* W7 B  k3 w你好,针对您的问题有一下疑问:
" d( M5 y6 V& _* d" f
- b& x  m3 h/ Y; F$ L: ?1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?

( @- W: c4 P$ h% g使用的是arm的例程tl_devmem2(贴的图是修改过的程序,写使能中间的长时间时序是由于arm端打印每次数据造成的);我没有用核心板上的DSP,只用了arm和fpga
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发表于 2018-9-7 17:06:59 | 显示全部楼层
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》, [5 f" e! @$ m% ~% a
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 楼主| 发表于 2018-9-7 20:43:44 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:064 s( B' Q; a+ f8 f( y  L
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...
* J: }5 k1 C. C9 u2 ~" w$ x
就是按照那个文档操作的,然后发现采用m或者h模式的时候数据线和地址线出现了上述现象。采用b时地址线出现上述现象& Y8 q2 a/ f" G% ~
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 楼主| 发表于 2018-9-17 17:09:55 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:06
/ t! C) c4 `4 f数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...

* n; c) m  }# m0 C- n$ R! t1 Y陈工,这个问题咱们创龙有没有解决方案啊,为什么ARM和fpga通信时只能用8根数据线啊,而且地址线完全和数据不匹配,而且arm进行写操作基于的时钟是多少啊?麻烦您解答一下呗5 f: H3 u, H! j6 @$ u
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发表于 2018-9-29 10:46:15 | 显示全部楼层
您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看一下。
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 楼主| 发表于 2018-11-10 16:06:15 | 显示全部楼层
广州创龙莫工 发表于 2018-9-29 10:465 C) y9 u* T" }# Q; R; {2 P
您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看 ...
) Z' A: e! J% n. S& D; X+ S. i3 M
采用的OMAP-L138F上ARM与FPGA数据传输程序基于文件《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》。: ~+ Z' W1 |" }+ Y! N8 ~" z
& T- k: L3 k. k4 O* e4 U
现在遇到的问题:
- R0 R6 q' x- S1、16bit数据线高八位没有初始化,传输只采用低八位数据线,且16bit的数据会在低八位数据线分成两个8bit数发出;. v9 g+ V7 F4 d) e% G( l
2、地址线仅有低三位初始化,且变化方式与读使能不同步;emifa_ba1无变化;% J, |( e7 u/ C: D" C

7 E( R# i* c" X3 B, S, G4 W现象:
% h( o  e9 s5 }6 s1、linux端运行./tl-devmem2 0x60000000 256 m 52428(1100110011001100)FPGA端现象' R: T$ T1 ?( i& t! r" O
G:\EMIF问题\输入(m52428)
5 B0 j+ I1 d& g" KG:\EMIF问题\m52428addr4 b4 X1 S+ A0 T4 m; k) S" Y. w) j
2、linux端运行./tl-devmem2 0x60000000 256 h 52428(1100110011001100)FPGA端现象2 M+ c. T3 Y/ N3 A3 }/ p
G:\EMIF问题\输入(h52428)G:\EMIF问题\h52428addr7 ^) t  \6 A- [$ D( l$ f
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 楼主| 发表于 2018-11-10 16:09:43 | 显示全部楼层
2 D3 k% m: i  a* q8 \

" d! @" G. w9 \3 }$ ^: Q7 ]$ {
" @- X0 m5 r: u0 k( B4 V, A& [( Q' ]2 b! Y) R$ f

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发表于 2018-11-22 12:02:47 | 显示全部楼层
你好,emif的问题我们这边基本确认了。除了fpga端下载bit文件之后运行这几条指令再发送数据以外,需要加载这个驱动:tl138evm-emifa-sram,还有两个情况::1.tl138evm-emifa-sram这个驱动有bug,导致地址发送出错。2.FPGA端的程序也有点问题,频率太高,通信会出错。。以上的问题我们会在V2.1版本(目前使用的是2.0内核)更新完善上去。并且修改emif的FPGA端程序。新版本的内核发布时间是下周五(11月30日)
% f7 O7 l1 G5 ~  E# N' Y& t* Z, r% P8 U; e$ M% M' M/ E! R5 V2 W

& a0 k" r/ p7 W' @6 Z, P: B
) n. d7 V! |! f+ ?8 u

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